안녕하십니까 건동홍 라인 전전에 재학중인 3학년 학부생입니다. 이번 학기에 성적이 나쁘게 나와 총 gpa가 4.0/4.5입니다. 반도체 회로 설계쪽이 to가 많이 나지 않는다고 들었습니다..ㅠ 저희 학교만 봐도 자대 과탑들만 들어가고 있구요.. 어렵다고 해서 시도를 하지 않을 것은 아니지만 어떤 활동을 통해 제가 랩실에 어필할 수 있을 부분을 만들 수 있을지 궁금합니다. 그리고 보통 대학원 랩실은 언제 컨택하는지 궁금합니다.. 바쁘시겠지만 회로설계쪽 선배님들 의견을 여쭈어보고 싶습니다..ㅠㅠ
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댓글 6개
2024.06.28
회로이론,전자회로 성적, 설계한 프로젝트들 내용 정리, 졸작으로 만든 회로 정도가 어필될 수 있을 것 같아요
2024.06.28
대댓글 3개
2024.06.28
대댓글 1개